mirror of https://github.com/proxmox/mirror_qemu
Second half of mipssim support, plus documentation improvements.
git-svn-id: svn://svn.savannah.nongnu.org/qemu/trunk@3401 c046a42c-6fe2-441c-8c8c-71466251a162master
parent
6bf5b4e8a8
commit
f0fc6f8fbc
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@ -0,0 +1,167 @@
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/*
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* QEMU/mipssim emulation
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*
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* Emulates a very simple machine model similiar to the one use by the
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* proprietary MIPS emulator.
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*/
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#include "vl.h"
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#ifdef TARGET_WORDS_BIGENDIAN
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#define BIOS_FILENAME "mips_bios.bin"
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#else
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#define BIOS_FILENAME "mipsel_bios.bin"
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#endif
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#ifdef TARGET_MIPS64
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#define PHYS_TO_VIRT(x) ((x) | ~0x7fffffffULL)
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#else
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#define PHYS_TO_VIRT(x) ((x) | ~0x7fffffffU)
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#endif
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#define VIRT_TO_PHYS_ADDEND (-((int64_t)(int32_t)0x80000000))
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static void load_kernel (CPUState *env)
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{
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int64_t entry, kernel_low, kernel_high;
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long kernel_size;
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long initrd_size;
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ram_addr_t initrd_offset;
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kernel_size = load_elf(env->kernel_filename, VIRT_TO_PHYS_ADDEND,
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||||||
|
&entry, &kernel_low, &kernel_high);
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||||||
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if (kernel_size >= 0) {
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||||||
|
if ((entry & ~0x7fffffffULL) == 0x80000000)
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||||||
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entry = (int32_t)entry;
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||||||
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env->PC[env->current_tc] = entry;
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||||||
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} else {
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fprintf(stderr, "qemu: could not load kernel '%s'\n",
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||||||
|
env->kernel_filename);
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exit(1);
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}
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/* load initrd */
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initrd_size = 0;
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initrd_offset = 0;
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if (env->initrd_filename) {
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||||||
|
initrd_size = get_image_size (env->initrd_filename);
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||||||
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if (initrd_size > 0) {
|
||||||
|
initrd_offset = (kernel_high + ~TARGET_PAGE_MASK) & TARGET_PAGE_MASK;
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||||||
|
if (initrd_offset + initrd_size > env->ram_size) {
|
||||||
|
fprintf(stderr,
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||||||
|
"qemu: memory too small for initial ram disk '%s'\n",
|
||||||
|
env->initrd_filename);
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||||||
|
exit(1);
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|
}
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||||||
|
initrd_size = load_image(env->initrd_filename,
|
||||||
|
phys_ram_base + initrd_offset);
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|
}
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||||||
|
if (initrd_size == (target_ulong) -1) {
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||||||
|
fprintf(stderr, "qemu: could not load initial ram disk '%s'\n",
|
||||||
|
env->initrd_filename);
|
||||||
|
exit(1);
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||||||
|
}
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||||||
|
}
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||||||
|
}
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static void main_cpu_reset(void *opaque)
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{
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CPUState *env = opaque;
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|
cpu_reset(env);
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||||||
|
cpu_mips_register(env, NULL);
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||||||
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if (env->kernel_filename)
|
||||||
|
load_kernel (env);
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|
}
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static void
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|
mips_mipssim_init (int ram_size, int vga_ram_size, int boot_device,
|
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|
DisplayState *ds, const char **fd_filename, int snapshot,
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||||||
|
const char *kernel_filename, const char *kernel_cmdline,
|
||||||
|
const char *initrd_filename, const char *cpu_model)
|
||||||
|
{
|
||||||
|
char buf[1024];
|
||||||
|
unsigned long bios_offset;
|
||||||
|
CPUState *env;
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int ret;
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mips_def_t *def;
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/* Init CPUs. */
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if (cpu_model == NULL) {
|
||||||
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#ifdef TARGET_MIPS64
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|
cpu_model = "5Kf";
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||||||
|
#else
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||||||
|
cpu_model = "24Kf";
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||||||
|
#endif
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}
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|
if (mips_find_by_name(cpu_model, &def) != 0)
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|
def = NULL;
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|
env = cpu_init();
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||||||
|
cpu_mips_register(env, def);
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|
register_savevm("cpu", 0, 3, cpu_save, cpu_load, env);
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||||||
|
qemu_register_reset(main_cpu_reset, env);
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|
/* Allocate RAM. */
|
||||||
|
cpu_register_physical_memory(0, ram_size, IO_MEM_RAM);
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||||||
|
/* Map the BIOS / boot exception handler. */
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|
bios_offset = ram_size + vga_ram_size;
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/* Load a BIOS / boot exception handler image. */
|
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|
if (bios_name == NULL)
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|
bios_name = BIOS_FILENAME;
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|
snprintf(buf, sizeof(buf), "%s/%s", bios_dir, bios_name);
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||||||
|
ret = load_image(buf, phys_ram_base + bios_offset);
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|
if ((ret < 0 || ret > BIOS_SIZE) && !kernel_filename) {
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||||||
|
/* Bail out if we have neither a kernel image nor boot vector code. */
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||||||
|
fprintf(stderr,
|
||||||
|
"qemu: Could not load MIPS bios '%s', and no -kernel argument was specified\n",
|
||||||
|
buf);
|
||||||
|
exit(1);
|
||||||
|
} else {
|
||||||
|
/* We have a boot vector start address. */
|
||||||
|
env->PC[env->current_tc] = (target_long)0xbfc00000;
|
||||||
|
cpu_register_physical_memory(0x1fc00000LL,
|
||||||
|
ret, bios_offset | IO_MEM_ROM);
|
||||||
|
}
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||||||
|
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||||||
|
if (kernel_filename) {
|
||||||
|
env->ram_size = ram_size;
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||||||
|
env->kernel_filename = kernel_filename;
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||||||
|
env->kernel_cmdline = kernel_cmdline;
|
||||||
|
env->initrd_filename = initrd_filename;
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||||||
|
load_kernel(env);
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|
}
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||||||
|
/* Init CPU internal devices. */
|
||||||
|
cpu_mips_irq_init_cpu(env);
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|
cpu_mips_clock_init(env);
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||||||
|
cpu_mips_irqctrl_init();
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||||||
|
/* Register 64 KB of ISA IO space at 0x1fd00000. */
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||||||
|
isa_mmio_init(0x1fd00000, 0x00010000);
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||||||
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||||||
|
/* A single 16450 sits at offset 0x3f8. It is attached to
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||||||
|
MIPS CPU INT2, which is interrupt 4. */
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||||||
|
if (serial_hds[0])
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||||||
|
serial_init(0x3f8, env->irq[4], serial_hds[0]);
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||||||
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||||||
|
if (nd_table[0].vlan) {
|
||||||
|
if (nd_table[0].model == NULL
|
||||||
|
|| strcmp(nd_table[0].model, "mipsnet") == 0) {
|
||||||
|
/* MIPSnet uses the MIPS CPU INT0, which is interrupt 2. */
|
||||||
|
mipsnet_init(0x4200, env->irq[2], &nd_table[0]);
|
||||||
|
} else if (strcmp(nd_table[0].model, "?") == 0) {
|
||||||
|
fprintf(stderr, "qemu: Supported NICs: mipsnet\n");
|
||||||
|
exit (1);
|
||||||
|
} else {
|
||||||
|
fprintf(stderr, "qemu: Unsupported NIC: %s\n", nd_table[0].model);
|
||||||
|
exit (1);
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||||||
|
}
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||||||
|
}
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|
}
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|
QEMUMachine mips_mipssim_machine = {
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|
"mipssim",
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||||||
|
"MIPS MIPSsim platform",
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||||||
|
mips_mipssim_init,
|
||||||
|
};
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@ -0,0 +1,269 @@
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||||||
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#include "vl.h"
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||||||
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#define DEBUG_MIPSNET_SEND
|
||||||
|
#define DEBUG_MIPSNET_RECEIVE
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//#define DEBUG_MIPSNET_DATA
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|
#define DEBUG_MIPSNET_IRQ
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||||||
|
/* MIPSnet register offsets */
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#define MIPSNET_DEV_ID 0x00
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||||||
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# define MIPSNET_DEV_ID_STRING "MIPSNET0"
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#define MIPSNET_BUSY 0x08
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||||||
|
#define MIPSNET_RX_DATA_COUNT 0x0c
|
||||||
|
#define MIPSNET_TX_DATA_COUNT 0x10
|
||||||
|
#define MIPSNET_INT_CTL 0x14
|
||||||
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# define MIPSNET_INTCTL_TXDONE 0x00000001
|
||||||
|
# define MIPSNET_INTCTL_RXDONE 0x00000002
|
||||||
|
# define MIPSNET_INTCTL_TESTBIT 0x80000000
|
||||||
|
#define MIPSNET_INTERRUPT_INFO 0x18
|
||||||
|
#define MIPSNET_RX_DATA_BUFFER 0x1c
|
||||||
|
#define MIPSNET_TX_DATA_BUFFER 0x20
|
||||||
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||||||
|
#define MAX_ETH_FRAME_SIZE 1514
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|
typedef struct MIPSnetState {
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|
uint32_t busy;
|
||||||
|
uint32_t rx_count;
|
||||||
|
uint32_t rx_read;
|
||||||
|
uint32_t tx_count;
|
||||||
|
uint32_t tx_written;
|
||||||
|
uint32_t intctl;
|
||||||
|
uint8_t rx_buffer[MAX_ETH_FRAME_SIZE];
|
||||||
|
uint8_t tx_buffer[MAX_ETH_FRAME_SIZE];
|
||||||
|
qemu_irq irq;
|
||||||
|
VLANClientState *vc;
|
||||||
|
NICInfo *nd;
|
||||||
|
} MIPSnetState;
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||||||
|
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||||||
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static void mipsnet_reset(MIPSnetState *s)
|
||||||
|
{
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||||||
|
s->busy = 1;
|
||||||
|
s->rx_count = 0;
|
||||||
|
s->rx_read = 0;
|
||||||
|
s->tx_count = 0;
|
||||||
|
s->tx_written = 0;
|
||||||
|
s->intctl = 0;
|
||||||
|
memset(s->rx_buffer, 0, MAX_ETH_FRAME_SIZE);
|
||||||
|
memset(s->tx_buffer, 0, MAX_ETH_FRAME_SIZE);
|
||||||
|
}
|
||||||
|
|
||||||
|
static void mipsnet_update_irq(MIPSnetState *s)
|
||||||
|
{
|
||||||
|
int isr = !!s->intctl;
|
||||||
|
#ifdef DEBUG_MIPSNET_IRQ
|
||||||
|
printf("mipsnet: Set IRQ to %d (%02x)\n", isr, s->intctl);
|
||||||
|
#endif
|
||||||
|
qemu_set_irq(s->irq, isr);
|
||||||
|
}
|
||||||
|
|
||||||
|
static int mipsnet_buffer_full(MIPSnetState *s)
|
||||||
|
{
|
||||||
|
if (s->rx_count >= MAX_ETH_FRAME_SIZE)
|
||||||
|
return 1;
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int mipsnet_can_receive(void *opaque)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
|
||||||
|
if (s->busy)
|
||||||
|
return 0;
|
||||||
|
return !mipsnet_buffer_full(s);
|
||||||
|
}
|
||||||
|
|
||||||
|
static void mipsnet_receive(void *opaque, const uint8_t *buf, int size)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
|
||||||
|
#ifdef DEBUG_MIPSNET_RECEIVE
|
||||||
|
printf("mipsnet: receiving len=%d\n", size);
|
||||||
|
#endif
|
||||||
|
if (!mipsnet_can_receive(opaque))
|
||||||
|
return;
|
||||||
|
|
||||||
|
s->busy = 1;
|
||||||
|
|
||||||
|
/* Just accept everything. */
|
||||||
|
|
||||||
|
/* Write packet data. */
|
||||||
|
memcpy(s->rx_buffer, buf, size);
|
||||||
|
|
||||||
|
s->rx_count = size;
|
||||||
|
s->rx_read = 0;
|
||||||
|
|
||||||
|
/* Now we can signal we have received something. */
|
||||||
|
s->intctl |= MIPSNET_INTCTL_RXDONE;
|
||||||
|
mipsnet_update_irq(s);
|
||||||
|
}
|
||||||
|
|
||||||
|
static uint32_t mipsnet_ioport_read(void *opaque, uint32_t addr)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
int ret = 0;
|
||||||
|
const char *devid = MIPSNET_DEV_ID_STRING;
|
||||||
|
|
||||||
|
addr &= 0x3f;
|
||||||
|
switch (addr) {
|
||||||
|
case MIPSNET_DEV_ID:
|
||||||
|
ret = *((uint32_t *)&devid);
|
||||||
|
break;
|
||||||
|
case MIPSNET_DEV_ID + 4:
|
||||||
|
ret = *((uint32_t *)(&devid + 4));
|
||||||
|
break;
|
||||||
|
case MIPSNET_BUSY:
|
||||||
|
ret = s->busy;
|
||||||
|
break;
|
||||||
|
case MIPSNET_RX_DATA_COUNT:
|
||||||
|
ret = s->rx_count;
|
||||||
|
break;
|
||||||
|
case MIPSNET_TX_DATA_COUNT:
|
||||||
|
ret = s->tx_count;
|
||||||
|
break;
|
||||||
|
case MIPSNET_INT_CTL:
|
||||||
|
ret = s->intctl;
|
||||||
|
s->intctl &= ~MIPSNET_INTCTL_TESTBIT;
|
||||||
|
break;
|
||||||
|
case MIPSNET_INTERRUPT_INFO:
|
||||||
|
/* XXX: This seems to be a per-VPE interrupt number. */
|
||||||
|
ret = 0;
|
||||||
|
break;
|
||||||
|
case MIPSNET_RX_DATA_BUFFER:
|
||||||
|
if (s->rx_count) {
|
||||||
|
s->rx_count--;
|
||||||
|
ret = s->rx_buffer[s->rx_read++];
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
/* Reads as zero. */
|
||||||
|
case MIPSNET_TX_DATA_BUFFER:
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
#ifdef DEBUG_MIPSNET_DATA
|
||||||
|
printf("mipsnet: read addr=0x%02x val=0x%02x\n", addr, ret);
|
||||||
|
#endif
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void mipsnet_ioport_write(void *opaque, uint32_t addr, uint32_t val)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
|
||||||
|
addr &= 0x3f;
|
||||||
|
#ifdef DEBUG_MIPSNET_DATA
|
||||||
|
printf("mipsnet: write addr=0x%02x val=0x%02x\n", addr, val);
|
||||||
|
#endif
|
||||||
|
switch (addr) {
|
||||||
|
case MIPSNET_TX_DATA_COUNT:
|
||||||
|
s->tx_count = (val <= MAX_ETH_FRAME_SIZE) ? val : 0;
|
||||||
|
s->tx_written = 0;
|
||||||
|
break;
|
||||||
|
case MIPSNET_INT_CTL:
|
||||||
|
if (val & MIPSNET_INTCTL_TXDONE) {
|
||||||
|
s->intctl &= ~MIPSNET_INTCTL_TXDONE;
|
||||||
|
} else if (val & MIPSNET_INTCTL_RXDONE) {
|
||||||
|
s->intctl &= ~MIPSNET_INTCTL_RXDONE;
|
||||||
|
} else if (val & MIPSNET_INTCTL_TESTBIT) {
|
||||||
|
mipsnet_reset(s);
|
||||||
|
s->intctl |= MIPSNET_INTCTL_TESTBIT;
|
||||||
|
} else if (!val) {
|
||||||
|
/* ACK testbit interrupt, flag was cleared on read. */
|
||||||
|
}
|
||||||
|
s->busy = !!s->intctl;
|
||||||
|
mipsnet_update_irq(s);
|
||||||
|
break;
|
||||||
|
case MIPSNET_TX_DATA_BUFFER:
|
||||||
|
s->tx_buffer[s->tx_written++] = val;
|
||||||
|
if (s->tx_written == s->tx_count) {
|
||||||
|
/* Send buffer. */
|
||||||
|
#ifdef DEBUG_MIPSNET_SEND
|
||||||
|
printf("mipsnet: sending len=%d\n", s->tx_count);
|
||||||
|
#endif
|
||||||
|
qemu_send_packet(s->vc, s->tx_buffer, s->tx_count);
|
||||||
|
s->tx_count = s->tx_written = 0;
|
||||||
|
s->intctl |= MIPSNET_INTCTL_TXDONE;
|
||||||
|
s->busy = 1;
|
||||||
|
mipsnet_update_irq(s);
|
||||||
|
}
|
||||||
|
break;
|
||||||
|
/* Read-only registers */
|
||||||
|
case MIPSNET_DEV_ID:
|
||||||
|
case MIPSNET_BUSY:
|
||||||
|
case MIPSNET_RX_DATA_COUNT:
|
||||||
|
case MIPSNET_INTERRUPT_INFO:
|
||||||
|
case MIPSNET_RX_DATA_BUFFER:
|
||||||
|
default:
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
static void mipsnet_save(QEMUFile *f, void *opaque)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
|
||||||
|
qemu_put_be32s(f, &s->busy);
|
||||||
|
qemu_put_be32s(f, &s->rx_count);
|
||||||
|
qemu_put_be32s(f, &s->rx_read);
|
||||||
|
qemu_put_be32s(f, &s->tx_count);
|
||||||
|
qemu_put_be32s(f, &s->tx_written);
|
||||||
|
qemu_put_be32s(f, &s->intctl);
|
||||||
|
qemu_put_buffer(f, s->rx_buffer, MAX_ETH_FRAME_SIZE);
|
||||||
|
qemu_put_buffer(f, s->tx_buffer, MAX_ETH_FRAME_SIZE);
|
||||||
|
}
|
||||||
|
|
||||||
|
static int mipsnet_load(QEMUFile *f, void *opaque, int version_id)
|
||||||
|
{
|
||||||
|
MIPSnetState *s = opaque;
|
||||||
|
|
||||||
|
if (version_id > 0)
|
||||||
|
return -EINVAL;
|
||||||
|
|
||||||
|
qemu_get_be32s(f, &s->busy);
|
||||||
|
qemu_get_be32s(f, &s->rx_count);
|
||||||
|
qemu_get_be32s(f, &s->rx_read);
|
||||||
|
qemu_get_be32s(f, &s->tx_count);
|
||||||
|
qemu_get_be32s(f, &s->tx_written);
|
||||||
|
qemu_get_be32s(f, &s->intctl);
|
||||||
|
qemu_get_buffer(f, s->rx_buffer, MAX_ETH_FRAME_SIZE);
|
||||||
|
qemu_get_buffer(f, s->tx_buffer, MAX_ETH_FRAME_SIZE);
|
||||||
|
|
||||||
|
return 0;
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}
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void mipsnet_init (int base, qemu_irq irq, NICInfo *nd)
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{
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MIPSnetState *s;
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||||||
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s = qemu_mallocz(sizeof(MIPSnetState));
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||||||
|
if (!s)
|
||||||
|
return;
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||||||
|
|
||||||
|
register_ioport_write(base, 36, 1, mipsnet_ioport_write, s);
|
||||||
|
register_ioport_read(base, 36, 1, mipsnet_ioport_read, s);
|
||||||
|
register_ioport_write(base, 36, 2, mipsnet_ioport_write, s);
|
||||||
|
register_ioport_read(base, 36, 2, mipsnet_ioport_read, s);
|
||||||
|
register_ioport_write(base, 36, 4, mipsnet_ioport_write, s);
|
||||||
|
register_ioport_read(base, 36, 4, mipsnet_ioport_read, s);
|
||||||
|
|
||||||
|
s->irq = irq;
|
||||||
|
s->nd = nd;
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||||||
|
if (nd && nd->vlan) {
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|
s->vc = qemu_new_vlan_client(nd->vlan, mipsnet_receive,
|
||||||
|
mipsnet_can_receive, s);
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|
} else {
|
||||||
|
s->vc = NULL;
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||||||
|
}
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|
snprintf(s->vc->info_str, sizeof(s->vc->info_str),
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|
"mipsnet macaddr=%02x:%02x:%02x:%02x:%02x:%02x",
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||||||
|
s->nd->macaddr[0],
|
||||||
|
s->nd->macaddr[1],
|
||||||
|
s->nd->macaddr[2],
|
||||||
|
s->nd->macaddr[3],
|
||||||
|
s->nd->macaddr[4],
|
||||||
|
s->nd->macaddr[5]);
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||||||
|
|
||||||
|
mipsnet_reset(s);
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||||||
|
register_savevm("mipsnet", 0, 0, mipsnet_save, mipsnet_load, s);
|
||||||
|
}
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|
@ -2037,7 +2037,7 @@ The MIPS Malta prototype board "malta"
|
||||||
@item
|
@item
|
||||||
An ACER Pica "pica61"
|
An ACER Pica "pica61"
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||||||
@item
|
@item
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||||||
MIPS MIPSsim emulator pseudo board "mipssim"
|
MIPS emulator pseudo board "mipssim"
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||||||
@end itemize
|
@end itemize
|
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||||||
The generic emulation is supported by Debian 'Etch' and is able to
|
The generic emulation is supported by Debian 'Etch' and is able to
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||||||
|
@ -2085,7 +2085,9 @@ PC Keyboard
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||||||
IDE controller
|
IDE controller
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||||||
@end itemize
|
@end itemize
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The MIPSsim emulation supports:
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The mipssim pseudo board emulation provides an environment similiar
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|
to what the proprietary MIPS emulator uses for running Linux.
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It supports:
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@itemize @minus
|
@itemize @minus
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||||||
@item
|
@item
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